时序逻辑电路中,双稳态是指输出两个状态在时钟脉冲信号发出后都可以保持不变
问题更新日期:2024-10-11 12:22:26
问题描述
时序逻辑电路中,双稳态是指输出两个状态在时钟脉冲信号发出后都可以保持不变求高手给解答
- 精选答案
-
不是的。
双稳态是指输出两个状态在时钟脉冲信号发出后,由一个稳态翻转到另一个稳态。
也就是说,Q端原来是1态,Q反是0态,时钟脉冲信号发出后,对双稳态触发器触发翻转,翻转后状态为:Q端为0态,Q反为1态。
凡是时钟脉冲信号发出一次,双稳态触发器就翻转一次。
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