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verilog wire总线定义

金融考研上岸学姐 | 简单学习,快乐成才!         
问题更新日期:2024-10-15 03:14:18

问题描述

verilog wire总线定义求高手给解答
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Verilog 中变量的物理数据分为线型和寄存器型。这两种类型的变量在定义时要设置位宽,缺省为1位。变量的每一位可以是0,1,X,Z。