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verilog中哪些是并行执行的,哪些是顺序执行的

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问题更新日期:2024-10-15 22:55:33

问题描述

verilog中哪些是并行执行的,哪些是顺序执行的急求答案,帮忙回答下
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所有的always块是并行的,达到触发就运行,assign也是,beign-end中是顺序,但这个所谓的顺序也是需要看实际情况,所以很多在begin-end中依然用if-else或case来解决,verilog重要的是时序,你可以在编完程序后做波形图来看,重点是上升沿下降沿等变化和赋值,可以用功能仿真来观察时序效果