在总线时序中什么是setup和hold time
问题更新日期：2024-10-15 23:34:50
问题描述
在总线时序中什么是setup和hold time求高手给解答
- 精选答案
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Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。
建立时间是指触 发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿 （如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time. 如不满足setup
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