在DSPbuilder设计中怎么使用外部的VHDL/VerilogHDL代码
问题更新日期：2024-10-16 11:06:19
问题描述
在DSPbuilder设计中怎么使用外部的VHDL/VerilogHDL代码，麻烦给回复
- 精选答案
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DSP Builder可以把simulink中的模块转换成VHDL，Altera与Matlab有个接口，安装DSP Builder后，simulink的library中会出现相应的toolbox，只有该toolbox中的模块可以转换成VHDL。
你可以在simulink中搭建整个信号处理系统，仿真成功后，除输入输出信号外，系统的其他部分都可以转换成VHDL。
之后可以在Quartus中对其进行功能或时序仿真，并下载到目标板
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