sram的地址译码方式
问题描述
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SRAM的地址译码方式有两种:单译码方式和双译码方式。
单译码方式,也称为字结构方式,在一个16位的存储器中,共有64个存储单元,排列成16行4列的矩阵。每个小方块表示一个存储单元,电路设有4根地址线,可寻址2^4=16个地址逻辑单元。将每个字的所有4位看成一个逻辑单元,使每个逻辑单元的4个存储单元具有相同的地址码,译码电路输出的16根字线刚好可以选择16个逻辑单元。每选中一个地址,对应字线的4位存储单元同时被选中。选中的存储单元将与数据位线连通,即可按照要求实现读或写操作。
双译码结构下,地址译码存储器分为两个部分:行译码器和列译码器。每个存储单元由一个触发器和两个交叉点开关组成,存取控制和读写操作由行和列的译码信号共同完成。行译码器对存储器的行进行译码,列译码器对存储器的列进行译码。行和列的译码输出分别同时送至交叉点开关,再送至存贮单元的触发器。读操作时,还需要从触发器输出端返回数据线至读写电路。写操作时,数据从写入电路送至数据线,再写入存储单元。
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地址译码有两种方式,一种是单译码方式,或称为字结构方式;另一种是双译码方式,或称为X-Y译码结构。
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