如何用verilog实现dsp的归一化命令
问题更新日期：2024-10-28 11:01:48
问题描述
如何用verilog实现dsp的归一化命令求高手给解答
- 精选答案
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首先输入不用设高阻 然后一般都是DSP主动操作，FPGA没法主动往DSP里送数据，就算你送到总线上了，DSP也不知道要去读，所以还是要例化一个RAM，单双口皆可，把数据存里面等 DSP 主动来读的
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